ADSP-BF527通過外設接口總線設置HOST CONTROL寄存器的HOST_EN位使能HOSTDP。如果禁止HOSTDP，應在清除HOST_EN位前將HOST_RST置位。一旦使能HOSTDP則由外部主機控制。外部主機通過編程設置DMA發(fā)送和接收數(shù)據(jù)，并將其存儲到ADSP-BF527有效的內(nèi)部和外部存儲器中。

　　4.1 HOSTDP設置

　　數(shù)據(jù)傳輸前，主機需配置DMA控制器。主機首先讀取從機HOST_STATUS寄存器的ALLOW_CNFG位。如果允許配置，主機將向HOSTDP發(fā)送7個16位控制字。主機通過這些控制字配置HOSTDP的DMA讀寫、DMA模式、起始地址等參數(shù)。接收所有控制字后，ADSP-BF527根據(jù)控制字重新配置HOETDP。在配置完成前，主機處理器不允許提供新控制字。通過寫入控制字，該設計將DMA設置為應答模式，數(shù)據(jù)傳輸采用停止模式。

　　總線寬度16位，以先傳輸?shù)臀粩?shù)據(jù)的順序傳輸數(shù)據(jù)。配置完成后，主機以所配置的方式讀寫數(shù)據(jù)，從而實現(xiàn)數(shù)據(jù)傳輸。數(shù)據(jù)傳輸過程中，通過ADSP-BF527軟件編程設置控制寄存器中HER和EHW位使能或禁止主機讀寫HOSTDP，HER和EHW的設置，不會影響到寫配置口、控制命令和讀狀態(tài)。由于主機不能查詢HOSTDP的HER和EHW位，因此，該系統(tǒng)設計ADSP-BF527一直保持HER和EHW位使能。

　　4.2 數(shù)據(jù)讀寫流程

　　當使能HOSTDP,DMA通道配置后，主機通過所配置的DMA通道與ADSP—BF527通信。數(shù)據(jù)讀寫時，在有效數(shù)據(jù)的最后需附加一個傳輸終止字確保數(shù)據(jù)傳輸。數(shù)據(jù)寫操作用于主機向從機的數(shù)據(jù)傳輸。MCF5272將ADSP-BF527所需的信號與設置寫入HOSTDP的FIFO，DMA同時將從FIFO移出數(shù)據(jù)，并存儲到DMA配置字規(guī)定的存儲器。數(shù)據(jù)讀操作用于從機向主機數(shù)據(jù)傳輸。ADSP—BF527的DMA將從機存儲器中的數(shù)字信號處理結果移至HOSTDP的FIFO。主機執(zhí)行讀操作，從FIFO中讀取數(shù)據(jù)。

　　停止模式下ADSP-BF527的HOSTDP讀寫操作流程如圖2所示。其中，DMA_DONE位在DMA將FIFO數(shù)據(jù)移出后置1，在下一次主機寫數(shù)據(jù)時置O。HOSTRD_DONE位在主機將FIFO的數(shù)據(jù)移出后置l，下一次主機讀操作，DMA向FIFO傳輸數(shù)據(jù)時置為0。

　　應答模式下，主機對HOSTDP的操作時序如圖3所示。在預定讀寫溢出時間內(nèi)，ADSP-BF527仍未完成相應的讀寫操作，主機未接收到HRDY信號，主機超時寄存器計數(shù)溢出并產(chǎn)生超時中斷。該設計的中斷服務程序首先通過GPIO引腳告知主機數(shù)據(jù)讀寫失敗，停止DMA通道數(shù)據(jù)傳輸;當主機重置HRDY信號為高電平，允許下一周期繼續(xù)傳輸數(shù)據(jù);并禁止HOSTDP，在停止模式下，具體的主機讀寫數(shù)據(jù)流程如圖4所示。

　　5 結語

　　隨著自動化領域監(jiān)測、控制任務對嵌入式系統(tǒng)的要求不斷提高，多處理器硬件系統(tǒng)模式的快速發(fā)展，電子技術和半導體加工工藝的發(fā)展促使DSP和MCU的融合。因此，MCU+DSP的雙處理器結構已成為多核處理器的發(fā)展方向。