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            EEPW首頁 > 嵌入式系統(tǒng) > 設(shè)計應(yīng)用 > 基于FPGA嵌入式系統(tǒng)的雷達(dá)目標(biāo)模擬器的設(shè)計

            基于FPGA嵌入式系統(tǒng)的雷達(dá)目標(biāo)模擬器的設(shè)計

            作者: 時間:2011-08-10 來源:網(wǎng)絡(luò) 收藏

            3 調(diào)試結(jié)果

              利用信號模擬產(chǎn)生一些典型的視頻信號,驗證了在工程上的可行性。

            圖3為頻率控制字為1 500時的線性調(diào)頻脈沖信號,脈寬為10 μs

            圖3

            圖4為非相參視頻脈沖串,脈沖寬度為10 μs,重復(fù)周期為700 μs

            圖4

            圖5為相參視頻脈沖串,脈沖寬度為10 μs,重復(fù)周期為700 μs,多普勒調(diào)制頻率為200 Hz。

            圖5

              利用了嵌入微處理器在控制方面的靈活性,在修改參數(shù)重新對進(jìn)行配置時,只需完成對應(yīng)的軟件編譯,節(jié)省了芯片再配置的時間;完成了相參、非相參、線性調(diào)頻脈沖串等中頻、視頻信號的模擬和韋布爾、對數(shù)正態(tài)、K分布3種典型分布模型的雜波模擬;利用實測雷達(dá)回波數(shù)據(jù)實現(xiàn)了實際雷達(dá)回波的重構(gòu),該系統(tǒng)產(chǎn)生的信號能夠基本滿足雷達(dá)接收系統(tǒng)性能的測試。

            linux操作系統(tǒng)文章專題:linux操作系統(tǒng)詳解(linux不再難懂)

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